AD9511BCPZ-REEL7

L'AD9511 est un circuit intégré de distribution d'horloge de 1,2GHz, un noyau PLL, un diviseur, un réglage du retard et cinq sorties. Il fournit une fonction de circuit intégré de distribution d'horloge à sorties multiples avec un noyau PLL sur puce. La conception met l'accent sur la faible gigue et le bruit de phase pour optimiser les performances du convertisseur de données. D'autres applications avec des exigences élevées en matière de bruit de phase et de gigue bénéficient également de ce composant La section PLL se compose d'un diviseur de référence programmable (R); un détecteur de fréquence de phase (PFD) à faible bruit ; une pompe de charge de précision et un diviseur de rétroaction programmable. En connectant un VCXO ou VCO externe aux broches CLK2/CLK2B, les fréquences jusqu'à 1,6GHz peuvent être synchronisées avec la référence d'entrée Il y a cinq sorties d'horloge indépendantes. L'application comprend une faible gigue, une distribution d'horloge à faible bruit de phase, des ADC à haute vitesse, des DAC, des DDS, des DDC, des DUC, des MxFE, des transceivers sans fil haute performance, une instrumentation haute performance et une infrastructure large bande.

• Boucle à verrouillage de phase, faible bruit de phase, fréquences d'entrée de référence à 250MHz
• Prédiviseur programmable à double module, courant de pompe de charge (CP) programmable
• Alimentation CP séparée (VCPS) étend la plage de réglage
• Deux entrées d'horloge différentielle de 1,6GHz, 5 diviseurs programmables, 1 à 32, tous entiers
• Sélection de phase pour le réglage grossier du retard de sortie à sortie
• Réglage fin du retard sur 1 sortie LVDS/CMOS, port de contrôle série
• Plage de fréquence d'entrée de 0MHz à 250MHz (VS = 3,3V ±5%, TA = 25°C)
• Valeur haute 4,8mA typique (avec CPRSET = 5,1 Kohm, TA = 25°C)
• Précision absolue de 2,5% typique (VCP = VCPS/2, VS = 3,3V ±5%, TA = 25°C)
• Boîtier LFCSP 48 broches, Plage de température de -40°C à +85°C

Remarques

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